IMPLEMENTAÇÃO E SIMULAÇÃO DE UMA UNIDADE LÓGICA E ARITMÉTICA DE 16 BITS COM AS OPERAÇÕES DE MULTIPLICAÇÃO, DESLOCAMENTO E ROTAÇÃO DE BITS EM VHDL
Parole chiave:
ULA; LDH;Bancada de TesteAbstract
Este trabalho apresenta a implementação em VHDL de uma ULA(Unidade Lógica e Aritmética) de 16 bits com as 11 operações lógicas e aritméticas, além das operações de multiplicação, deslocamento e rotação de bits. Os resultados das simulações de casos de testes foram gerados utilizando test benches específicas da linguagem VHDL. O modelo da ULA foi projetado possibilitando que o módulo possa ser utilizado como componente para o projeto de ULA 16, 32, 64 bits ou mais. Os resultados da simulação comprovam que este projeto foi executado com sucesso conforme o esperado.
Riferimenti bibliografici
EDA Playground. Disponível em <https://edaplayground.com/>. Acesso em: 27 de ago. de 2021.
OLIVEIRA, A. F.; OLIVEIRA, E. M.Implementação de uma unidade lógica e aritmética de 16 bits com as operações de multiplicação, deslocamento e rotação de bits em VHDL. 2021. Monografia (Bacharelado em Engenharia Elétrica), Universidade do Estado de Minas Gerais – UEMG, Campus Ituiutaba, 2021.
PEDRONI, Volnei A. Circuit design and simulation with VHDL. 2nd ed. Cambridge: MIT Press, 2010.
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Artigo: " ________________________________________________"
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